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Procesador RISC-V de Ciclo Único en Verilog para un Curso Industrial

FreeVerified credential4 semanasIntermediate

Visión general

De qué trata este proyecto.

Implementa en Verilog un procesador RISC-V de ciclo único con 37 instrucciones y obtén un certificado verificable

El escenario

La empresa (alrededor de 480 personas en MX, parte de un grupo internacional anónimo) recibe 20 ingenieros junior por año desde universidades locales; un kit reproducible reduce el tiempo de onboarding técnico en arquitectura de ~6 semanas a ~3 según el lead que lo encargó.

CredentialBlockchain-anchored
ShareableLinkedIn-ready
LanguageEnglish
PaceSelf-paced

El Briefing

Lo que harás y lo que demostrarás.

Implementar un procesador RISC-V RV32I de ciclo único en Verilog que pase el set oficial riscv-tests rv32ui-p y venga con guía didáctica reproducible.

Earning criteria — what you'll demonstrate

  • Implementar las 37 instrucciones RV32I con datapath y control
  • Verificar un procesador contra un test set oficial reproducible
  • Razonar sobre tradeoffs de ciclo único (frecuencia mínima vs simplicidad)
  • Producir documentación didáctica que un junior siga sin ayuda

Encaje académico

Dónde encaja esto en tus estudios.

Afina las mismas habilidades que tu titulación espera de ti.

Computer Architecture

Bachelor · Systems

Strong alignment

This challenge maps to Computer Architecture at the Bachelor level. It sharpens the same practical skills your coursework expects — but in a real industry context with actual constraints and deliverables.

Carreras

Roles para los que esto te prepara.

Títulos reales. Puentes de habilidades reales. Elige el que más se acerque a tu trayectoria.

Ingeniero de Software

Construir y verificar un CPU RISC-V completo da una mentalidad de máquina que ningún tutorial reemplaza — credencial para ingeniero de software en sistemas, embebidos o compiladores.

Este proyecto afina

  • verilog
  • cpu-design
  • verification

Ingeniero Backend

Quien entiende qué hace un procesador a nivel de datapath escribe código backend más consciente del coste real — ventaja en sistemas con latencia o throughput críticos.

Este proyecto afina

  • digital-logic
  • cpu-design
  • simulation

Arquitecto de Sistemas

La base de hardware completa es prerrequisito para arquitectos que diseñan plataformas donde silicon y software conviven (FPGA, edge, aceleradores) — perfil escaso y valorado.

Este proyecto afina

  • risc-v
  • cpu-design
  • digital-logic

Una cosa más

Puedes tener una credencial en tu CV para el viernes.