Verilog
Si te gusta aplicar Verilog, cada reto aquí te da la oportunidad de practicarlo en un briefing industrial real.
- CodePrincipianteNuevo
Procesador RISC-V de Ciclo Único en Verilog para un Curso Industrial
Implementa los bloques en Verilog: registro de archivo (32 registros de 32 bits), ALU con 10 operaciones, memoria de instrucciones, memoria de datos, unidad de control combinaci…
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- Cpu Design
- Risc V
Computer Architecture - DesignPrincipianteNuevo
Sintetizador de audio FPGA para taller maker LATAM
Diseña en Verilog: 8 osciladores DDS (Direct Digital Synthesis — síntesis digital directa) con tablas de onda en BRAM, mezclador con saturación, envelope ADSR (Attack, Decay, Su…
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- Fpga
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Multidisciplinar - CodeIntermedioNuevo
Procesador RISC-V de 5 etapas en Verilog para curso de hardware
Diseña un procesador RV32I con 5 etapas (IF, ID, EX, MEM, WB), forwarding de EX/MEM y MEM/WB hacia EX, stall en load-use hazard y flush en saltos taken predecidos como not-taken…
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- Risc V
- Pipelining
Multidisciplinar
Cómo funciona
Del briefing al certificado, en seis pasos.
Paso 01
Explora retos alineados con tus estudios.
Paso 02
Acepta el que encaja con tus metas.
Paso 03
Trabájalo con la guía del AI Copilot.
Paso 04
Envíalo para una evaluación estructurada.
Paso 05
Consigue una credencial verificada.
Paso 06
Añádela a LinkedIn con un solo clic.
Equipos del sector tras una década de briefings prácticos
¿Reclutando de este grupo?
Patrocina un reto y conoce candidatos a través de su trabajo real.
Los equipos de la industria pueden diseñar briefings en torno a las habilidades que buscan, y evaluar a los estudiantes por entregables puntuados con rúbrica — no por currículums.